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Projet
CAPS
- Thèses
- 1
- T. MONTAUT,
Méthodes pour l'élimination du faux partage et
l'optimisation de la localité sur une machine parallèle à
mémoire virtuelle partagée, thèse de doctorat, université
de Rennes 1, septembre 1996.
- Articles
- 2
- F. BODIN,
A. SEZNEC, ``Skewed
Associativity improves performance and enhances
predictability'', IEEE Transactions on Computers, à
paraître.
- 3
- N. DRACH,
E. ROHOU,
A. SEZNEC,
``Influence de la structure du pipeline sur les instructions de
chargement'', Revue Technique et Science Informatiques
(TSI), janvier 1996.
- 4
- D. DURAND,
T. MONTAUT,
L. KERVELLA,
W. JALBY, ``Impact
of Memory Contention on Dynamic Scheduling on NUMA
Multiprocessors'', IEEE Transactions on Parallel and
Distributed Systems, décembre 1996.
- 5
- Y. JéGOU,
``Exploitation du parallélisme à grain fin par migration de
tâches sur les architectures à mémoires distribuées'',
Calculateurs Parallèles, octobre 1996.
- 6
- A. SEZNEC,
``Decoupled Sectored Caches'', IEEE Transactions on
Computers, à paraître.
- Communications à
congrès
- 7
- B. ARNALDI,
T. PRIOL,
L. RENAMBOT,
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- 8
- M. AUGUIN,
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Technology, Boston, USA, octobre 1996.
- 9
- D. BADOUEL,
T. PRIOL,
L. RENAMBOT,
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- 10
- F. BODIN,
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R. QUINIOU,
``Cabaret: A Fortran Case Base Reasoning System for Porting
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octobre 1996.
- 11
- S. CHAUVEAU,
F. BODIN, ``MENHIR,
a Tool for High Performance Code Generation'', in:
Proceedings of the European Parallel Tools Meeting,
Chatillon, France, octobre 1996.
- 12
- S. HILY,
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- 13
- Y. JéGOU, ``Fine
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1996.
- 14
- Y. JéGOU, ``The
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in: Proceedings of Euro-Par'96 Parallel Processing,
L. Bougé, P. Fraigniaud, A. Mignotte,
Y. Robert (réd.), Lecture Notes in Computer
Science, 1123, p. I:562-570, Lyon, France, août
1996.
- 15
- M. PIC,
F. BODIN,
H. ESSAFI, ``CT++ :
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Environment for Image Processing Architecture'', in:
Proceedings of Workshop ``Domain Specific Systems'' of The
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1996.
- 16
- T. PRIOL,
``Mémoire Virtuellement Partagée pour le calcul de haute
performance: évolution et tendances'', in: Mémoire
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1996.
- 17
- E. ROHOU,
F. BODIN,
A. SEZNEC, ``SALTO:
System for Assembly-Language Transormation and Optimization'',
in: Sixth Workshop on Compilers for Parallel
Computers, décembre 1996.
- 18
- A. SEZNEC,
S.JOURDAN,
P. SAINRAT,
P. MICHAUD,
``Multiple-Block Ahead Branch Predictors'', in: Proceedings
of the 7th conference on Architectural Support for Programming
Languages and Operating Systems, Boston, octobre
1996.
- 19
- A. SEZNEC,
``Don't use the page number, but a pointer on it'', in:
Proceedings of the 23nd International Symposium on Computer
Architecture (IEEE-ACM), Philadelphie, mai 1996.
- Rapports de
recherche
- 20
- B. ARNALDI,
T. PRIOL,
L. RENAMBOT,
X. PUEYO,
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on Multiprocessors'', publication interne n°1055,
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http://www.irisa.fr/bibli/pi/1055/1055.html
- 21
- P. MICHAUD,
A. SEZNEC,
R. UHLIG, ``Skewed
Branch Predictors'', publication interne n°1031,
Irisa, juin 1996.
http://www.irisa.fr/bibli/pi/1031/1031.html
- 22
- T. PRIOL,
``Draft specification of the runtime system'', rapport de
contrat, Projet Esprit Pacha, 1996.
- 23
- T. PRIOL,
``Final specification of the runtime system'', rapport de
contrat, Projet Esprit Pacha, 1996.
- 24
- E. ROHOU,
F. BODIN,
A. SEZNEC,
G. L. FOL,
F. CHAROT,
F. RAIMBAULT,
``SALTO: System for Assembly-Language Transormation and
Optimization'', publication interne n°1032, Irisa,
juin 1996.
http://www.irisa.fr/bibli/pi/1032/1032.html
- 25
- A. SEZNEC,
F. LLOANSI, ``Etude
des architectures des microprocesseurs MIPS R10000, UltraSparc
et PentiumPro'', publication interne n°1024, Irisa,
mai 1996.
http://www.irisa.fr/bibli/pi/1024/1024.html
- 26
- D. N. TRUONG,
F. BODIN,
A. SEZNEC,
``Accurate Data Layout into Blocks May Boost Cache
Performance'', publication interne n°1000, Irisa, mars
1996.
http://www.irisa.fr/bibli/pi/1000/1000.html